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qcom,glymur-gcc.h

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linux-6.19.14/include/dt-bindings/clock/qcom,glymur-gcc.h C
  1/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
  2/*
  3 * Copyright (c) Qualcomm Technologies, Inc. and/or its subsidiaries.
  4 */
  5
  6#ifndef _DT_BINDINGS_CLK_QCOM_GCC_GLYMUR_H
  7#define _DT_BINDINGS_CLK_QCOM_GCC_GLYMUR_H
  8
  9/* GCC clocks */
 10#define GCC_GPLL0						0
 11#define GCC_GPLL0_OUT_EVEN					1
 12#define GCC_GPLL1						2
 13#define GCC_GPLL14						3
 14#define GCC_GPLL14_OUT_EVEN					4
 15#define GCC_GPLL4						5
 16#define GCC_GPLL5						6
 17#define GCC_GPLL7						7
 18#define GCC_GPLL8						8
 19#define GCC_GPLL9						9
 20#define GCC_AGGRE_NOC_PCIE_3A_WEST_SF_AXI_CLK			10
 21#define GCC_AGGRE_NOC_PCIE_3B_WEST_SF_AXI_CLK			11
 22#define GCC_AGGRE_NOC_PCIE_4_WEST_SF_AXI_CLK			12
 23#define GCC_AGGRE_NOC_PCIE_5_EAST_SF_AXI_CLK			13
 24#define GCC_AGGRE_NOC_PCIE_6_WEST_SF_AXI_CLK			14
 25#define GCC_AGGRE_UFS_PHY_AXI_CLK				15
 26#define GCC_AGGRE_UFS_PHY_AXI_HW_CTL_CLK			16
 27#define GCC_AGGRE_USB2_PRIM_AXI_CLK				17
 28#define GCC_AGGRE_USB3_MP_AXI_CLK				18
 29#define GCC_AGGRE_USB3_PRIM_AXI_CLK				19
 30#define GCC_AGGRE_USB3_SEC_AXI_CLK				20
 31#define GCC_AGGRE_USB3_TERT_AXI_CLK				21
 32#define GCC_AGGRE_USB4_0_AXI_CLK				22
 33#define GCC_AGGRE_USB4_1_AXI_CLK				23
 34#define GCC_AGGRE_USB4_2_AXI_CLK				24
 35#define GCC_AV1E_AHB_CLK					25
 36#define GCC_AV1E_AXI_CLK					26
 37#define GCC_AV1E_XO_CLK						27
 38#define GCC_BOOT_ROM_AHB_CLK					28
 39#define GCC_CAMERA_AHB_CLK					29
 40#define GCC_CAMERA_HF_AXI_CLK					30
 41#define GCC_CAMERA_SF_AXI_CLK					31
 42#define GCC_CAMERA_XO_CLK					32
 43#define GCC_CFG_NOC_PCIE_ANOC_AHB_CLK				33
 44#define GCC_CFG_NOC_PCIE_ANOC_SOUTH_AHB_CLK			34
 45#define GCC_CFG_NOC_USB2_PRIM_AXI_CLK				35
 46#define GCC_CFG_NOC_USB3_MP_AXI_CLK				36
 47#define GCC_CFG_NOC_USB3_PRIM_AXI_CLK				37
 48#define GCC_CFG_NOC_USB3_SEC_AXI_CLK				38
 49#define GCC_CFG_NOC_USB3_TERT_AXI_CLK				39
 50#define GCC_CFG_NOC_USB_ANOC_AHB_CLK				40
 51#define GCC_CFG_NOC_USB_ANOC_SOUTH_AHB_CLK			41
 52#define GCC_DISP_AHB_CLK					42
 53#define GCC_DISP_HF_AXI_CLK					43
 54#define GCC_EVA_AHB_CLK						44
 55#define GCC_EVA_AXI0_CLK					45
 56#define GCC_EVA_AXI0C_CLK					46
 57#define GCC_EVA_XO_CLK						47
 58#define GCC_GP1_CLK						48
 59#define GCC_GP1_CLK_SRC						49
 60#define GCC_GP2_CLK						50
 61#define GCC_GP2_CLK_SRC						51
 62#define GCC_GP3_CLK						52
 63#define GCC_GP3_CLK_SRC						53
 64#define GCC_GPU_CFG_AHB_CLK					54
 65#define GCC_GPU_GEMNOC_GFX_CLK					55
 66#define GCC_GPU_GPLL0_CLK_SRC					56
 67#define GCC_GPU_GPLL0_DIV_CLK_SRC				57
 68#define GCC_PCIE_0_AUX_CLK					58
 69#define GCC_PCIE_0_AUX_CLK_SRC					59
 70#define GCC_PCIE_0_CFG_AHB_CLK					60
 71#define GCC_PCIE_0_MSTR_AXI_CLK					61
 72#define GCC_PCIE_0_PHY_RCHNG_CLK				62
 73#define GCC_PCIE_0_PHY_RCHNG_CLK_SRC				63
 74#define GCC_PCIE_0_PIPE_CLK					64
 75#define GCC_PCIE_0_SLV_AXI_CLK					65
 76#define GCC_PCIE_0_SLV_Q2A_AXI_CLK				66
 77#define GCC_PCIE_1_AUX_CLK					67
 78#define GCC_PCIE_1_AUX_CLK_SRC					68
 79#define GCC_PCIE_1_CFG_AHB_CLK					69
 80#define GCC_PCIE_1_MSTR_AXI_CLK					70
 81#define GCC_PCIE_1_PHY_RCHNG_CLK				71
 82#define GCC_PCIE_1_PHY_RCHNG_CLK_SRC				72
 83#define GCC_PCIE_1_PIPE_CLK					73
 84#define GCC_PCIE_1_SLV_AXI_CLK					74
 85#define GCC_PCIE_1_SLV_Q2A_AXI_CLK				75
 86#define GCC_PCIE_2_AUX_CLK					76
 87#define GCC_PCIE_2_AUX_CLK_SRC					77
 88#define GCC_PCIE_2_CFG_AHB_CLK					78
 89#define GCC_PCIE_2_MSTR_AXI_CLK					79
 90#define GCC_PCIE_2_PHY_RCHNG_CLK				80
 91#define GCC_PCIE_2_PHY_RCHNG_CLK_SRC				81
 92#define GCC_PCIE_2_PIPE_CLK					82
 93#define GCC_PCIE_2_SLV_AXI_CLK					83
 94#define GCC_PCIE_2_SLV_Q2A_AXI_CLK				84
 95#define GCC_PCIE_3A_AUX_CLK					85
 96#define GCC_PCIE_3A_AUX_CLK_SRC					86
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101#define GCC_PCIE_3A_PIPE_CLK					91
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103#define GCC_PCIE_3A_SLV_AXI_CLK					93
104#define GCC_PCIE_3A_SLV_Q2A_AXI_CLK				94
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109#define GCC_PCIE_3B_PHY_RCHNG_CLK				99
110#define GCC_PCIE_3B_PHY_RCHNG_CLK_SRC				100
111#define GCC_PCIE_3B_PIPE_CLK					101
112#define GCC_PCIE_3B_PIPE_CLK_SRC				102
113#define GCC_PCIE_3B_PIPE_DIV2_CLK				103
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115#define GCC_PCIE_3B_SLV_AXI_CLK					105
116#define GCC_PCIE_3B_SLV_Q2A_AXI_CLK				106
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118#define GCC_PCIE_4_AUX_CLK_SRC					108
119#define GCC_PCIE_4_CFG_AHB_CLK					109
120#define GCC_PCIE_4_MSTR_AXI_CLK					110
121#define GCC_PCIE_4_PHY_RCHNG_CLK				111
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123#define GCC_PCIE_4_PIPE_CLK					113
124#define GCC_PCIE_4_PIPE_CLK_SRC					114
125#define GCC_PCIE_4_PIPE_DIV2_CLK				115
126#define GCC_PCIE_4_PIPE_DIV_CLK_SRC				116
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129#define GCC_PCIE_5_AUX_CLK					119
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139#define GCC_PCIE_5_SLV_AXI_CLK					129
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141#define GCC_PCIE_6_AUX_CLK					131
142#define GCC_PCIE_6_AUX_CLK_SRC					132
143#define GCC_PCIE_6_CFG_AHB_CLK					133
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145#define GCC_PCIE_6_PHY_RCHNG_CLK				135
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149#define GCC_PCIE_6_PIPE_DIV2_CLK				139
150#define GCC_PCIE_6_PIPE_DIV_CLK_SRC				140
151#define GCC_PCIE_6_SLV_AXI_CLK					141
152#define GCC_PCIE_6_SLV_Q2A_AXI_CLK				142
153#define GCC_PCIE_NOC_PWRCTL_CLK					143
154#define GCC_PCIE_NOC_QOSGEN_EXTREF_CLK				144
155#define GCC_PCIE_NOC_SF_CENTER_CLK				145
156#define GCC_PCIE_NOC_SLAVE_SF_EAST_CLK				146
157#define GCC_PCIE_NOC_SLAVE_SF_WEST_CLK				147
158#define GCC_PCIE_NOC_TSCTR_CLK					148
159#define GCC_PCIE_PHY_3A_AUX_CLK					149
160#define GCC_PCIE_PHY_3A_AUX_CLK_SRC				150
161#define GCC_PCIE_PHY_3B_AUX_CLK					151
162#define GCC_PCIE_PHY_3B_AUX_CLK_SRC				152
163#define GCC_PCIE_PHY_4_AUX_CLK					153
164#define GCC_PCIE_PHY_4_AUX_CLK_SRC				154
165#define GCC_PCIE_PHY_5_AUX_CLK					155
166#define GCC_PCIE_PHY_5_AUX_CLK_SRC				156
167#define GCC_PCIE_PHY_6_AUX_CLK					157
168#define GCC_PCIE_PHY_6_AUX_CLK_SRC				158
169#define GCC_PCIE_RSCC_CFG_AHB_CLK				159
170#define GCC_PCIE_RSCC_XO_CLK					160
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172#define GCC_PDM2_CLK_SRC					162
173#define GCC_PDM_AHB_CLK						163
174#define GCC_PDM_XO4_CLK						164
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176#define GCC_QMIP_CAMERA_CMD_AHB_CLK				166
177#define GCC_QMIP_CAMERA_NRT_AHB_CLK				167
178#define GCC_QMIP_CAMERA_RT_AHB_CLK				168
179#define GCC_QMIP_GPU_AHB_CLK					169
180#define GCC_QMIP_PCIE_3A_AHB_CLK				170
181#define GCC_QMIP_PCIE_3B_AHB_CLK				171
182#define GCC_QMIP_PCIE_4_AHB_CLK					172
183#define GCC_QMIP_PCIE_5_AHB_CLK					173
184#define GCC_QMIP_PCIE_6_AHB_CLK					174
185#define GCC_QMIP_VIDEO_CV_CPU_AHB_CLK				175
186#define GCC_QMIP_VIDEO_CVP_AHB_CLK				176
187#define GCC_QMIP_VIDEO_V_CPU_AHB_CLK				177
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190#define GCC_QUPV3_OOB_CORE_2X_CLK				180
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198#define GCC_QUPV3_OOB_S0_CLK_SRC				188
199#define GCC_QUPV3_OOB_S1_CLK					189
200#define GCC_QUPV3_OOB_S1_CLK_SRC				190
201#define GCC_QUPV3_OOB_S_AHB_CLK					191
202#define GCC_QUPV3_OOB_TCXO_CLK					192
203#define GCC_QUPV3_WRAP0_CORE_2X_CLK				193
204#define GCC_QUPV3_WRAP0_CORE_CLK				194
205#define GCC_QUPV3_WRAP0_QSPI_S2_CLK				195
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210#define GCC_QUPV3_WRAP0_QSPI_S6_CLK_SRC				200
211#define GCC_QUPV3_WRAP0_S0_CLK					201
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220#define GCC_QUPV3_WRAP0_S4_CLK_SRC				210
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222#define GCC_QUPV3_WRAP0_S5_CLK_SRC				212
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226#define GCC_QUPV3_WRAP0_S7_CLK_SRC				216
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244#define GCC_QUPV3_WRAP1_S4_CLK_SRC				234
245#define GCC_QUPV3_WRAP1_S5_CLK					235
246#define GCC_QUPV3_WRAP1_S5_CLK_SRC				236
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248#define GCC_QUPV3_WRAP1_S6_CLK_SRC				238
249#define GCC_QUPV3_WRAP1_S7_CLK					239
250#define GCC_QUPV3_WRAP1_S7_CLK_SRC				240
251#define GCC_QUPV3_WRAP2_CORE_2X_CLK				241
252#define GCC_QUPV3_WRAP2_CORE_CLK				242
253#define GCC_QUPV3_WRAP2_QSPI_S2_CLK				243
254#define GCC_QUPV3_WRAP2_QSPI_S2_CLK_SRC				244
255#define GCC_QUPV3_WRAP2_QSPI_S3_CLK				245
256#define GCC_QUPV3_WRAP2_QSPI_S3_CLK_SRC				246
257#define GCC_QUPV3_WRAP2_QSPI_S6_CLK				247
258#define GCC_QUPV3_WRAP2_QSPI_S6_CLK_SRC				248
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260#define GCC_QUPV3_WRAP2_S0_CLK_SRC				250
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262#define GCC_QUPV3_WRAP2_S1_CLK_SRC				252
263#define GCC_QUPV3_WRAP2_S2_CLK					253
264#define GCC_QUPV3_WRAP2_S2_CLK_SRC				254
265#define GCC_QUPV3_WRAP2_S3_CLK					255
266#define GCC_QUPV3_WRAP2_S3_CLK_SRC				256
267#define GCC_QUPV3_WRAP2_S4_CLK					257
268#define GCC_QUPV3_WRAP2_S4_CLK_SRC				258
269#define GCC_QUPV3_WRAP2_S5_CLK					259
270#define GCC_QUPV3_WRAP2_S5_CLK_SRC				260
271#define GCC_QUPV3_WRAP2_S6_CLK					261
272#define GCC_QUPV3_WRAP2_S6_CLK_SRC				262
273#define GCC_QUPV3_WRAP2_S7_CLK					263
274#define GCC_QUPV3_WRAP2_S7_CLK_SRC				264
275#define GCC_QUPV3_WRAP_0_M_AHB_CLK				265
276#define GCC_QUPV3_WRAP_0_S_AHB_CLK				266
277#define GCC_QUPV3_WRAP_1_M_AHB_CLK				267
278#define GCC_QUPV3_WRAP_1_S_AHB_CLK				268
279#define GCC_QUPV3_WRAP_2_M_AHB_CLK				269
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281#define GCC_SDCC2_AHB_CLK					271
282#define GCC_SDCC2_APPS_CLK					272
283#define GCC_SDCC2_APPS_CLK_SRC					273
284#define GCC_SDCC4_AHB_CLK					274
285#define GCC_SDCC4_APPS_CLK					275
286#define GCC_SDCC4_APPS_CLK_SRC					276
287#define GCC_UFS_PHY_AHB_CLK					277
288#define GCC_UFS_PHY_AXI_CLK					278
289#define GCC_UFS_PHY_AXI_CLK_SRC					279
290#define GCC_UFS_PHY_AXI_HW_CTL_CLK				280
291#define GCC_UFS_PHY_ICE_CORE_CLK				281
292#define GCC_UFS_PHY_ICE_CORE_CLK_SRC				282
293#define GCC_UFS_PHY_ICE_CORE_HW_CTL_CLK				283
294#define GCC_UFS_PHY_PHY_AUX_CLK					284
295#define GCC_UFS_PHY_PHY_AUX_CLK_SRC				285
296#define GCC_UFS_PHY_PHY_AUX_HW_CTL_CLK				286
297#define GCC_UFS_PHY_RX_SYMBOL_0_CLK				287
298#define GCC_UFS_PHY_RX_SYMBOL_0_CLK_SRC				288
299#define GCC_UFS_PHY_RX_SYMBOL_1_CLK				289
300#define GCC_UFS_PHY_RX_SYMBOL_1_CLK_SRC				290
301#define GCC_UFS_PHY_TX_SYMBOL_0_CLK				291
302#define GCC_UFS_PHY_TX_SYMBOL_0_CLK_SRC				292
303#define GCC_UFS_PHY_UNIPRO_CORE_CLK				293
304#define GCC_UFS_PHY_UNIPRO_CORE_CLK_SRC				294
305#define GCC_UFS_PHY_UNIPRO_CORE_HW_CTL_CLK			295
306#define GCC_USB20_MASTER_CLK					296
307#define GCC_USB20_MASTER_CLK_SRC				297
308#define GCC_USB20_MOCK_UTMI_CLK					298
309#define GCC_USB20_MOCK_UTMI_CLK_SRC				299
310#define GCC_USB20_MOCK_UTMI_POSTDIV_CLK_SRC			300
311#define GCC_USB20_SLEEP_CLK					301
312#define GCC_USB30_MP_MASTER_CLK					302
313#define GCC_USB30_MP_MASTER_CLK_SRC				303
314#define GCC_USB30_MP_MOCK_UTMI_CLK				304
315#define GCC_USB30_MP_MOCK_UTMI_CLK_SRC				305
316#define GCC_USB30_MP_MOCK_UTMI_POSTDIV_CLK_SRC			306
317#define GCC_USB30_MP_SLEEP_CLK					307
318#define GCC_USB30_PRIM_MASTER_CLK				308
319#define GCC_USB30_PRIM_MASTER_CLK_SRC				309
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483
484/* GCC resets */
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577
578#endif
~/ Read-only file preview.