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dma_ch_3_regs.h

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linux-6.19.14/drivers/accel/habanalabs/include/goya/asic_reg/dma_ch_3_regs.h C
  1/* SPDX-License-Identifier: GPL-2.0
  2 *
  3 * Copyright 2016-2018 HabanaLabs, Ltd.
  4 * All Rights Reserved.
  5 *
  6 */
  7
  8/************************************
  9 ** This is an auto-generated file **
 10 **       DO NOT EDIT BELOW        **
 11 ************************************/
 12
 13#ifndef ASIC_REG_DMA_CH_3_REGS_H_
 14#define ASIC_REG_DMA_CH_3_REGS_H_
 15
 16/*
 17 *****************************************
 18 *   DMA_CH_3 (Prototype: DMA_CH)
 19 *****************************************
 20 */
 21
 22#define mmDMA_CH_3_CFG0                                              0x419000
 23
 24#define mmDMA_CH_3_CFG1                                              0x419004
 25
 26#define mmDMA_CH_3_ERRMSG_ADDR_LO                                    0x419008
 27
 28#define mmDMA_CH_3_ERRMSG_ADDR_HI                                    0x41900C
 29
 30#define mmDMA_CH_3_ERRMSG_WDATA                                      0x419010
 31
 32#define mmDMA_CH_3_RD_COMP_ADDR_LO                                   0x419014
 33
 34#define mmDMA_CH_3_RD_COMP_ADDR_HI                                   0x419018
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 36#define mmDMA_CH_3_RD_COMP_WDATA                                     0x41901C
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 38#define mmDMA_CH_3_WR_COMP_ADDR_LO                                   0x419020
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 40#define mmDMA_CH_3_WR_COMP_ADDR_HI                                   0x419024
 41
 42#define mmDMA_CH_3_WR_COMP_WDATA                                     0x419028
 43
 44#define mmDMA_CH_3_LDMA_SRC_ADDR_LO                                  0x41902C
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 50#define mmDMA_CH_3_LDMA_DST_ADDR_HI                                  0x419038
 51
 52#define mmDMA_CH_3_LDMA_TSIZE                                        0x41903C
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 54#define mmDMA_CH_3_COMIT_TRANSFER                                    0x419040
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 72#define mmDMA_CH_3_DST_ADDR_LO_STS                                   0x419064
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 78#define mmDMA_CH_3_RD_RATE_LIM_EN                                    0x419070
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 83
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 91
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141
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167
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171
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174#define mmDMA_CH_3_TDMA_DST_STRIDE_1                                 0x41919C
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177
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180#define mmDMA_CH_3_TDMA_DST_VALID_ELEMENTS_2                         0x4191A8
181
182#define mmDMA_CH_3_TDMA_DST_START_OFFSET_2                           0x4191AC
183
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185
186#define mmDMA_CH_3_TDMA_DST_ROI_BASE_3                               0x4191B4
187
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190#define mmDMA_CH_3_TDMA_DST_VALID_ELEMENTS_3                         0x4191BC
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200#define mmDMA_CH_3_TDMA_DST_VALID_ELEMENTS_4                         0x4191D0
201
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207
208#endif /* ASIC_REG_DMA_CH_3_REGS_H_ */
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